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DDR一致性测试基本参数
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以上只是 一 些进行DDR读/写信号分离的常用方法,根据不同的信号情况可以做选 择。对于DDR信号的 一 致性测试来说,用户还可以选择另外的方法,比如根据建立/保持 时间的不同进行分离或者基于CA信号突发时延的方法(CA高接下来对应读操作,CA低 接下来对应写操作)等,甚至未来有可能采用一些机器学习(Machine Learning)的方法对 读/写信号进行判别。读时序和写时序波形分离出来以后,就可以方便地进行波形参数或者 眼图模板的测量。

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DDR 规范的 DC 和 AC 特性

对于任何一种接口规范的设计,首先要搞清楚系统中传输的是什么样的信号,也就是驱动器能发出什么样的信号,接收器能接受和判别什么样的信号,用术语讲,就是信号的DC和AC特性要求。

在DDR规范文件JEDEC79R的第51页[TABLE6:ELECTRICALCHARACTERISTICSANDDCOPERATINGCONDITIONS]中对DDR的DC有明确要求:VCC=+2.5V+0.2V,Vref=+1.25V±0.05V,VTT=Vref±0.04V.

在我们的实际设计中,除了要精确设计供电电源模块之外,还需要对整个电源系统进行PI仿真,而这是高速系统设计中另一个需要考虑的问题,在这里我们先不讨论它,暂时认为系统能够提供稳定的供电电源。

除DC特性外,我们还应该注意规范中提到的AC特性,所谓AC特性,就是信号在高速利转状态下所表现出的动态变化特性。DDR规范中第60页,对外于云态变化的地址信号、控制信号及数据信号分别给出了交流特性的要求。为方便读者,现把规范中对干信号交流特性的要求复制到这里,作为高速系统设计的一部分,要确保在我们的系统中,所有处于高速工作状态下的DDR信号要符合这个AC特性规范。 吉林DDR一致性测试联系人DDR-致性测试探测和夹具;

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对于嵌入式应用的DDR的协议测试, 一般是DDR颗粒直接焊接在PCB板上,测试可 以选择针对逻辑分析仪设计的BGA探头。也可以设计时事先在板上留测试点,把被测信 号引到一些按一定规则排列的焊盘上,再通过相应探头的排针顶在焊盘上进行测试。

协议测试也可以和信号质量测试、电源测试结合起来,以定位由于信号质量或电源问题 造成的数据错误。图5.23是一个LPDDR4的调试环境,测试中用逻辑分析仪观察总线上 的数据,同时用示波器检测电源上的纹波和瞬态变化,通过把总线解码的数据和电源瞬态变 化波形做时间上的相关和同步触发,可以定位由于电源变化造成的总线读/写错误问题。

DDR规范没有定义模板,这给用眼图方式分析信号时判断信号是否满足规范要求带来挑战。有基于JEDEC规范定义的,ds、,dh、-H(ac)min和rIL(ac)max参数,得出的DDR2533写眼图的模板,中间的区域就是模板,中间的线是DQS的有效边沿即有效的上升沿或下降沿。严格按规范来说的话,中间的模板应该定义为横着的梯形,因为保持时间是相对于DC参数的,不过用长方形可以定义一个更严格的参数要求。

DDR总线一致性测试对示波器带宽的要求

因为Jedec规范没有给岀DDR具体的快的上升、下降时间,通过预估的方式可以得岀 快的边沿时间,但是往往比实际要快,是基于实际PCB板材的情况得出的结果,有 了这个结果可计算出需要的示波器带宽。 什么是DDR DDR2 DDR3 DDR4 DDR5;

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DDR5的接收端容限测试

前面我们在介绍USB3 . 0、PCIe等高速串行总线的测试时提到过很多高速的串行总线 由于接收端放置有均衡器,因此需要进行接收容限的测试以验证接收均衡器和CDR在恶劣 信 号 下 的 表 现 。 对 于 D D R 来 说 , D D R 4 及 之 前 的 总 线 接 收 端 还 相 对 比 较 简 单 , 只 是 做 一 些 匹配、时延、阈值的调整。但到了DDR5时代(图5 . 19),由于信号速率更高,因此接收端也 开 始 采 用 很 多 高 速 串 行 总 线 中 使 用 的 可 变 增 益 调 整 以 及 均 衡 器 技 术 , 这 也 使 得 D D R 5 测 试 中必须关注接收均衡器的影响,这是之前的DDR测试中不曾涉及的。 DDR4 一致性测试软件;广东自动化DDR一致性测试

快速 DDR4协议解码功能.辽宁DDR一致性测试维保

为了针对复杂信号进行更有效的读/写信号分离,现代的示波器还提供了很多高级的信号 分离功能,在DDR测试中常用的有图形区域触发的方法和基于建立/保持时间的触发方法。

图形区域触发是指可以用屏幕上的特定区域(Zone)定义信号触发条件。用 区域触发功能对DDR的读/写信号分离的 一 个例子。用锁存信号DQS信号触发可以看到 两种明显不同的DQS波形, 一 种是读时序的DQS波形,另 一 种是写信号的DQS波形。打 开区域触发功能后,通过在屏幕上的不同区域画不同的方框,就可以把感兴趣区域的DQS 波形保留下来,与之对应的数据线DQ上的波形也就保留下来了。 辽宁DDR一致性测试维保

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需要注意的是,由于DDR的总线上存在内存控制器和内存颗粒两种主要芯片,所以 DDR的信号质量测试理论上也应该同时涉及这两类芯片的测试。但是由于JEDEC只规定 了对于内存颗粒这一侧的信号质量的要求,因此DDR的自动测试软件也只对这一侧的信 号质量进行测试。对于内存控制器一侧的信号质量来说,不同控制器芯片厂商有不同的要 求,目前没有统一的规范,因此其信号质量的测试还只能使用手动的方法。这时用户可以在 内存控制器一侧选择测试点,并借助合适的信号读/写分离手段来进行手动测试。DDR4参数测试参考解决方案.福建DDR一致性测试销售电话由于DDR5工作时钟比较高到3.2GHz,系统裕量很小,因此信号的 ...

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